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当前位置:教育论文中心首页--硕士论文--音频DSP核低功耗研究及后端设计
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音频DSP核低功耗研究及后端设计
 
     论文目录
 
摘要第1-5页
ABSTRACT第5-9页
第一章 绪论第9-13页
   ·集成电路发展的现状第9-10页
   ·低功耗研究的意义第10-11页
   ·本文研究的内容和意义第11-13页
第二章 数字集成电路设计流程和低功耗研究第13-24页
   ·数字集成电路设计流程介绍第13-15页
   ·集成电路功耗的发展现状第15页
   ·功耗的分类第15-18页
     ·静态功耗第16-17页
     ·动态功耗第17-18页
       ·开关功耗第17-18页
       ·短路功耗第18页
   ·低功耗优化设计方法第18-24页
     ·系统级低功耗设计第19-20页
     ·算法级低功耗设计第20页
     ·RTL 级低功耗设计第20-21页
     ·逻辑级低功耗设计第21-23页
     ·物理级低功耗设计第23-24页
第三章 音频DSP 核的低功耗综合实现第24-40页
   ·音频DSP 核概述第24-27页
   ·从FPGA 到ASIC 设计第27页
   ·针对后端设计修改及验证第27-30页
   ·PTPX 功耗测试第30-32页
     ·仿真波形(VCD)文件的生成第30-31页
     ·PTPX 功耗测试过程第31-32页
   ·门控时钟技术第32-34页
   ·存储器分块访问技术第34-35页
   ·DC Topography 技术第35-39页
   ·优化前后的功耗结果比较第39-40页
第四章 音频DSP 核的后端设计第40-61页
   ·后端设计的总体流程和相关EDA 工具介绍第40-42页
   ·设计方法学(Methodology)第42-43页
   ·布局规划第43-48页
     ·core 利用率的确定第43-45页
     ·子模块位置的制定第45-48页
   ·电源规划第48-51页
     ·全局电源第49页
     ·电源环第49-50页
     ·电源条线(Power Stripes)第50-51页
   ·布置及其优化第51-52页
   ·时钟树综合第52-56页
     ·与时钟有关的基本概念第53页
     ·时钟树综合的目的和过程第53-56页
   ·布线(Routing)第56-59页
     ·全局布线第56-57页
     ·精细布线(Detail Route)第57页
     ·布线修正第57-59页
   ·数据输出第59-61页
第五章 结论第61-62页
致谢第62-63页
参考文献第63-64页
攻硕期间取得的研究成果第64-65页

 
 
论文编号BS128766,这篇论文共65
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