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当前位置:教育论文中心首页--硕士论文--基于SMIC 65nm工艺的静态随机存储芯片的后端设计
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基于SMIC 65nm工艺的静态随机存储芯片的后端设计
 
     论文目录
 
摘要第1-6页
ABSTRACT第6-11页
符号对照表第11-12页
缩略语对照表第12-16页
第一章 绪论第16-20页
   ·专用集成电路后端设计的发展背景及国内外现状第16-18页
   ·课题背景及来源第18页
   ·章节安排第18-20页
第二章 集成电路的设计方法及仿真工具第20-26页
   ·设计学方法第20-23页
     ·展平式物理设计第20-21页
     ·硅虚拟原型设计第21-22页
     ·层次化物理设计第22-23页
   ·应用SoC Encounter工具进行后端设计的流程简介第23-24页
   ·数字集成电路的设计收敛第24-25页
   ·本章小结第25-26页
第三章 布图规划和布局方案及芯片布局实现第26-42页
   ·设计所需文件第26-30页
     ·物理库文件概述及芯片的LEF文件第26-27页
     ·时序库文件概述第27-28页
     ·设计约束文件概述及芯片的约束文件第28-29页
     ·网表文件概述及芯片的网表文件第29-30页
   ·布图规划概述第30-35页
     ·布图规划的主要内容和目标第30页
     ·I/O接口单元的放置与供电第30-32页
     ·布图规划方案第32-33页
     ·模块布放与布线通道第33-34页
     ·芯片布图规划的实现第34-35页
   ·电源规划原理及设计规划方案第35-38页
     ·电源网络设计第35-37页
     ·数字与模拟混合供电第37页
     ·芯片电源规划的实现第37-38页
   ·布局概述及芯片布局的实现方案第38-40页
     ·布局目标预估第38-39页
     ·特殊逻辑单元的布局第39页
     ·标准单元布局优化算法第39-40页
     ·芯片的布局实现结果第40页
   ·本章小结第40-42页
第四章 时钟信号理论及时钟树综合第42-58页
   ·时钟信号概述第42-45页
     ·系统时钟和时钟信号的生成第42-43页
     ·时钟信号的定义第43-44页
     ·时钟信号的延滞第44页
     ·时钟信号抖动和偏差第44-45页
   ·时钟树综合理论简介第45-48页
     ·标准设计约束文件第45-46页
     ·时钟树结构第46-47页
     ·时钟树综合第47-48页
   ·时钟树综合策略第48-50页
     ·自我交叉第48-49页
     ·相互交叉时钟第49页
     ·有用偏差第49-50页
     ·对时钟插入多驱动的缓冲器第50页
   ·芯片时钟树综合的实现方法第50-56页
     ·CTS的信号说明第51-52页
     ·时钟树约束文件和芯片的时钟树综合报告第52-56页
   ·本章小结第56-58页
第五章 布线理论及芯片的布线第58-68页
   ·布线理论介绍第58-60页
     ·全局布线第58-59页
     ·详细布线第59页
     ·其他特殊布线第59-60页
   ·天线效应第60-63页
     ·天线效应产生及解决第60-62页
     ·修复芯片的天线效应第62-63页
   ·串扰在布线中的预防和修复第63-65页
     ·串扰的产生第63-64页
     ·串扰的危害第64页
     ·串扰的预防与修复第64-65页
   ·芯片的布线实现第65页
   ·本章小结第65-68页
第六章 静态时序分析以及物理验证第68-84页
   ·静态时序分析第68-75页
     ·静态时序分析的理论介绍第68-71页
     ·解决时序违例的方案第71-72页
     ·芯片的静态时序分析结果第72-75页
   ·验证及芯片的最终实现结果第75-83页
     ·时序验证第75-79页
     ·物理验证与芯片组装第79-81页
     ·芯片物理验证及实现结果第81-83页
   ·本章小结第83-84页
第七章 总结第84-86页
参考文献第86-88页
致谢第88-90页
作者简介第90-91页

 
 
论文编号BS2436072,这篇论文共91
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