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面向FPGA的卷积神经网络模型映射工具的研究 |
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| 论文目录 |
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| 摘要 | 第3-5页 | | abstract | 第5-6页 | | 第一章 引言 | 第12-19页 | | 1.1 研究背景与意义 | 第12-13页 | | 1.2 研究现状 | 第13-16页 | | 1.2.1 FPGA硬件加速的研究现状 | 第13-15页 | | 1.2.2 面向FPGA的模型映射工具的研究现状 | 第15-16页 | | 1.3 论文的主要工作 | 第16-17页 | | 1.4 论文结构 | 第17-19页 | | 第二章 模型映射工具的前端设计与实现 | 第19-33页 | | 2.1 卷积神经网络 | 第20-25页 | | 2.1.1 经典架构 | 第21页 | | 2.1.2 卷积层 | 第21-22页 | | 2.1.3 池化层 | 第22-23页 | | 2.1.4 全连接层 | 第23页 | | 2.1.5 激活函数 | 第23-25页 | | 2.2 卷积神经网络的中间表示 | 第25-32页 | | 2.2.1 基于Protocol Buffer的模型描述文件 | 第25-30页 | | 2.2.2 模型参数文件和数据量化 | 第30-31页 | | 2.2.3 配置文件 | 第31-32页 | | 2.3 本章小结 | 第32-33页 | | 第三章 模型映射工具的后端设计与实现 | 第33-43页 | | 3.1 硬件设计与优化 | 第34-38页 | | 3.1.1 基本硬件架构 | 第34-35页 | | 3.1.2 优化策略 | 第35-36页 | | 3.1.3 硬件模板设计与实现 | 第36-38页 | | 3.2 控制软件的实现 | 第38-42页 | | 3.2.1 内存分配器 | 第38-41页 | | 3.2.2 运行时控制器 | 第41-42页 | | 3.3 本章小结 | 第42-43页 | | 第四章 FPGA异构验证平台的构建 | 第43-54页 | | 4.1 整体框架 | 第43-44页 | | 4.2 硬件验证平台的搭建 | 第44-48页 | | 4.2.1 硬件环境 | 第44-45页 | | 4.2.2 芯片启动与文件系统 | 第45-46页 | | 4.2.3 软硬件交互的实现 | 第46-48页 | | 4.3 图像采集模块 | 第48-53页 | | 4.3.1 解帧模块 | 第50-52页 | | 4.3.2 色彩空间转换模块 | 第52-53页 | | 4.4 本章小结 | 第53-54页 | | 第五章 实验结果与分析 | 第54-62页 | | 5.1 配置说明 | 第54页 | | 5.2 模型映射工具的输入预处理 | 第54-56页 | | 5.3 实验与结果分析 | 第56-61页 | | 5.3.1 模型映射工具测试 | 第57-60页 | | 5.3.2 实时目标检测测试 | 第60-61页 | | 5.4 本章小结 | 第61-62页 | | 第六章 总结与展望 | 第62-64页 | | 6.1 总结 | 第62-63页 | | 6.2 展望 | 第63-64页 | | 参考文献 | 第64-67页 | | 致谢 | 第67-68页 | | 攻读硕士学位期间已发表或录用的论文 | 第68-69页 | | 攻读硕士学位期间参加的项目 | 第69-71页 |
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论文编号BS4628732，这篇论文共71页
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