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FPGA高效布线方法研究 |
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| 论文目录 |
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| 摘要 | 第5-7页 | | ABSTRACT | 第7-9页 | | 符号对照表 | 第14-16页 | | 缩略语对照表 | 第16-20页 | | 第一章 绪论 | 第20-34页 | | 1.1 研究背景 | 第20-21页 | | 1.2 国内外研究现状 | 第21-30页 | | 1.2.1 串行FPGA布线算法 | 第21-27页 | | 1.2.2 并行FPGA布线算法 | 第27-29页 | | 1.2.3 目前方法存在的问题 | 第29-30页 | | 1.3 本文研究内容 | 第30-31页 | | 1.4 论文组织结构 | 第31-34页 | | 第二章 FPGA结构和开发流程 | 第34-50页 | | 2.1 岛型结构FPGA | 第34-39页 | | 2.1.1 可配置逻辑单元 | 第35-37页 | | 2.1.2 输入输出单元 | 第37-38页 | | 2.1.3 异构功能单元 | 第38页 | | 2.1.4 可编程连线资源 | 第38-39页 | | 2.2 FPGA EDA流程 | 第39-48页 | | 2.2.1 设计输入 | 第40-41页 | | 2.2.2 行为综合 | 第41-42页 | | 2.2.3 工艺映射 | 第42页 | | 2.2.4 打包 | 第42-43页 | | 2.2.5 布局 | 第43-47页 | | 2.2.6 布线 | 第47-48页 | | 2.2.7 位流生成 | 第48页 | | 2.3 本章小结 | 第48-50页 | | 第三章 一种利用高效重布线策略的时间优化FPGA布线算法 | 第50-78页 | | 3.1 FPGA布线问题 | 第50-52页 | | 3.2 利用高效重布线策略的时间优化FPGA布线算法 | 第52-71页 | | 3.2.1 总体框架 | 第52-57页 | | 3.2.2 布线算法 | 第57-60页 | | 3.2.3 新的迷宫布线算法 | 第60-65页 | | 3.2.4 高效重布线策略 | 第65-71页 | | 3.3 实验测试 | 第71-75页 | | 3.3.1 实验环境和测试电路介绍 | 第71-73页 | | 3.3.2 测试结果 | 第73-75页 | | 3.4 本章小结 | 第75-78页 | | 第四章 一种利用线网混合划分和并行策略的FPGA布线算法 | 第78-100页 | | 4.1 算法总体框架 | 第78-81页 | | 4.2 线网划分 | 第81-86页 | | 4.2.1 划分第一阶段 | 第82-84页 | | 4.2.2 划分第二阶段 | 第84-86页 | | 4.3 对互斥线网集合布线 | 第86-89页 | | 4.4 对重叠线网集合布线 | 第89-92页 | | 4.5 布线结果确定性分析 | 第92页 | | 4.6 实验结果 | 第92-97页 | | 4.6.1 实验环境和测试电路介绍 | 第92-93页 | | 4.6.2 负载平衡 | 第93-94页 | | 4.6.3 内存使用 | 第94-95页 | | 4.6.4 布线运行时间 | 第95-96页 | | 4.6.5 和现有方法比较 | 第96-97页 | | 4.7 本章小结 | 第97-100页 | | 第五章 实现两种FPGA布线算法的支持工具 | 第100-128页 | | 5.1 利用高效重布线策略的时间优化FPGA布线算法支持工具 | 第100-117页 | | 5.1.1 文件信息读取 | 第101-106页 | | 5.1.2 构建布线资源图 | 第106-108页 | | 5.1.3 线网布线 | 第108-114页 | | 5.1.4 实验结果 | 第114-117页 | | 5.2 利用线网混合划分和并行策略的FPGA布线算法支持工具 | 第117-126页 | | 5.2.1 线网划分 | 第117-121页 | | 5.2.2 多线程并行布线 | 第121-123页 | | 5.2.3 实验结果 | 第123-126页 | | 5.3 本章小结 | 第126-128页 | | 第六章 总结与展望 | 第128-132页 | | 6.1 工作总结 | 第128-129页 | | 6.2 研究展望 | 第129-132页 | | 参考文献 | 第132-142页 | | 致谢 | 第142-144页 | | 作者简介 | 第144-146页 |
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论文编号BS4576499，这篇论文共146页
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